23. Nov 2008, 16:23

SSSE3 (Supplemental Streaming SIMD Extensions 3) bezeichnet die mit Intels Core-Architektur eingeführten Erweiterungen des SSE3-Befehlssatzes.^[1] Firmenintern werden auch die Bezeichnungen „Tejas New Instructions“ (TNI) oder „Merom New Instructions“ (MNI) verwendet. SSSE3 wird fälschlicherweise oft als SSE4 bezeichnet, jedoch stellt SSE4 eine vollkommen andere Befehlssatzerweiterung dar.

[Bearbeiten] Neue Befehle

SSSE3 erweitert den SSE3-Befehlssatz um 16 neue Befehle. Da diese sowohl auf 64-Bit-MMX-Register als auch auf 128-Bit-SSE-Register angewendet werden können, gibt Intel an, es seien 32 Befehle.^[2]

• psignw, psignd, psignb
• pshufb
• pmulhrsw, pmaddubsw
• phsubw, phsubsw, phsubd
• phaddw, phaddsw, phaddd
• palignr
• pabsw, pabsd, pabsb

SSSE3 wurde als Teil der Intel-Core-Mikroarchitektur präsentiert, und erstmals in den Prozessorkernen Merom (Notebook), Allendale/Conroe (Desktop) und Woodcrest (Server) integriert.

[Bearbeiten] CPUs mit SSSE3

• Intel Atom (alle Prozessoren)
• Intel Celeron (ab Prozessorkern Conroe-L)
• Intel Celeron M (ab Prozessorkern Merom-1024)
• alle Prozessoren der Intel-Core-2-Serie
• Intel Pentium Dual-Core
• Intel Xeon (ab Prozessorkern Woodcrest)

[Bearbeiten] Fußnoten

1. ↑ [1]
2. ↑ Intel Funktionsreferenz N-Z

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