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TestMacBook Air mit M3 im Test: Klare Kaufempfehlung, wenn Windows nicht Trumpf ist
Das ist für das Frontend auch absolut korrekt.
Der Decoder schreibt dann allerdings die Befehle wiederum in die uOps oder auch micro Ops um.
Das wird z.B. auch für gute SIMD Auslastung benötigt. Befehle werden zerlegt und zu Paketen geschnürt um die mehreren Pipelines des CPU Kerns auszulasten.
Bei traditionellen RISC Architekturen passiert heutzutage genau das gleiche.
Damit hat man beim CPU design deutlich mehr Freiheitsgrade und kann Rechenschritte zusammenfassen oder auseinanderziehen wie man lustig ist.