Es gibt einen aktuellen Test:CDLABSRadonP... schrieb:
https://www.phoronix.com/review/azure-hbv5-amd-epyc-9v64h
News Neue CPUs von AMD: Ryzen 9700X3D und AI Max+ 388/392 gesichtet
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https://www.phoronix.com/review/azure-hbv5-amd-epyc-9v64h
@ETI1120 Wichtig weil es nicht explizit erwähnt wird: HBv5 bietet doppelt so viele Kerne wie HBv4. Beeindruckend sind also "nur" die Benchmarks mit mehr als doppelter Leistung (wovon es ja einige gibt).
Aber man sieht schon, dass eine Zen 5 X3D-Lösung bei vielen dieser getesteten Anwendungen nicht mithalten dürfte.
Aber man sieht schon, dass eine Zen 5 X3D-Lösung bei vielen dieser getesteten Anwendungen nicht mithalten dürfte.
CDLABSRadonP...
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ETI1120 schrieb:
Der Test ist schon merkwürdig unvollständig für Michael Larabel. Denn ob jeweils auf gleiche Threadanzahl limitiert wurde oder nicht darf man raten. Meine Vermutung ist, dass das hiermit...stefan92x schrieb:
...zusammenhängt und auch dann erst ein ordentlicher Artikel online geht.
Es kommt noch was dazu: Der Epyc 9V64H / MI300C hat ja gerade V-Cache 2.0, (oder 1.9 oder whatever) denn er basiert nun einmal auf dem MI300A-Layout.stefan92x schrieb:
Wie sehen eigentlich die Latenzen bei dem aus, wenn CCDs auf dem gleichen Basetile sitzen?
Nun, es ist auf jeden fall alles extrem komplex, allein schon in der Kostenbetrachtung.
Es ist eben kein ausführlicher Test sondern nur ein Artikel.CDLABSRadonP... schrieb:
Wird man sehen.CDLABSRadonP... schrieb:
Ob man diesen Cache wirklich mit dem der Genoa-X vergleichen kann ist nicht klar.CDLABSRadonP... schrieb:
Bei der MI300X ist dieser Cache nicht als Infinity Cache ausgewiesen.
Welche Latenzen meinst Du?CDLABSRadonP... schrieb:
Ich denke nicht. Es gibt keinen Turin-X weil Microsoft ihn nicht benötigt.CDLABSRadonP... schrieb:
Deshalb bin ich gespannt wie es bei Venice weiter geht.
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CCD0 greift auf L3-Cache von CCD1 & CCD2 zu.ETI1120 schrieb:
@CDLABSRadonP... Das müsste wohl mal jemand benchmarken, der Zugriff auf eine HBv5 Instanz hat. Ist aber wirklich eine interessante Frage, da das Design hier wie ein Hybrid aus Zen 1 und den späteren aussieht. Also eigener RAM pro IOD, wie Zen 1 eigenen Pro CCD hatte, aber eben auch mehrere CCD pro IOD
Die 256 MByte sind ein Last Level Cache und keine Erweiterung des L3 der CCDs.CDLABSRadonP... schrieb:
Im übrigen kommen auch 3 CCDs auf 64 MByte.
Ich denke es ist eher ein vier geteiltes Zen 2 IOD mit HBM Memory Controller.stefan92x schrieb:
Der LLC sorgt IMO dafür dass es beim Zugriff auf RAM über andere Base Dies keine Probleme gibt.
@stefan92x AMD ist generell ziemlich zugeknöpft was Details angeht. Es gibt ein paar Häppchen und den Rest muss man sich zusammen reimen.
Die nächsten Häppchen gibt es zur CES und dann wohl wieder zur Computex.
Die nächsten Häppchen gibt es zur CES und dann wohl wieder zur Computex.
@stefan92x Die 70 % hat AMD schon zur Vorstellung der MI350X erzählt.
Dass erst Zen 7 eine Matrix engine bekommt ist mau war aber bereits zu befürchten da nichts zu Matrix Befehlen im ersten Commit bei GCC zu Zen 6 zu sehen war.
Dass erst Zen 7 eine Matrix engine bekommt ist mau war aber bereits zu befürchten da nichts zu Matrix Befehlen im ersten Commit bei GCC zu Zen 6 zu sehen war.
Ah, war mir da wohl entgangen.ETI1120 schrieb:
Bei solchen Commits hat AMD sich aber selten mit Ruhm bekleckert, die waren leider oft weniger aussagekräftig als sie hätten sein sollen.ETI1120 schrieb:
Ergänzung ()
Nächste Woche auf der SC25 gibt es wohl mehr Infos zur MI430X wurde gerade geteasert... da bin ich ja mal gespannt, wie groß die Unterschiede wirklich sind zur normalen MI450X. Mehr FP64 ist klar, aber sonst?ETI1120 schrieb:
Zuletzt bearbeitet:
Deswegen habe ich geschrieben "war bereits zu befürchten". Es war möglich dass AMD wieder Spielchen spielt.stefan92x schrieb:
Im übrigen bleibt die Frage, wieso steht in der CPU Core "Roadmap" nur "Zen 7" und nicht "Zen 7" "Zen 7c"?
Der übliche Fehler oder gibt es tatsächlich weitere Kernoptionen?
Für die MI450X ist FP64 nicht relevant für die MI430X ist eine gute Balance zwischen FP64 und AI wichtig. Das Hybrid Compute bezieht sich IMO auf mischen von physikalischen Modellen und AI. Unterschiede im IOD würden mich überraschen.stefan92x schrieb:
Technisch gesehen war es noch weniger interessant als 2022. Praktisch keine Info zu Zen 6, Nichts zu RDNA5. Wenigstens ist nun klar dass es mit RDNA und CDNA als getrennten Linien weitergeht
Es gab nur ein paar Häppchen.
- Wenn die MI400 CoWoS-L verwendet, heißt es dass AMD glaubt große Packages mit mehreren Chiplets per Fanout hinzubekommen. Bei EPYC und Ryzen bleibt die Frage CoWoS-L oder CoWoS-R.
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