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NewsIntel Arrow Lake-S: P-Cores bekommen mehr L2-Cache, LGA-1851-Samples gesichtet
Das Streben nach stetig größeren Caches geht auch bei Intel weiter. Arrow Lakes P-Cores sollen 3 MByte L2-Cache pro Kern erhalten. Zuletzt waren gerade erst 2 MByte L2 pro Kern normal geworden, davor 1,25 MByte. Und wer noch länger zurückblickt, kommt schnell bei 256 KByte an.
Und wer NOCH länger zurückblickt, kommt schnell bei 0 an, wie z.B. der Covington an.
Dieser war mit seinen 266 Mhz langsamer war als 200 Mhz der Vorgänger-Generation Pentium 1. Nur aufgrund des fehlenden Caches...
...langsam könnte Intel die CPUs verlöten... die wechseln die Sockel wie andere die Unterwäsche 🤣
Andererseits... lieber nicht - wer weiß, zu welchen "Blödheiten" das Verlöten dann führt...
...langsam könnte Intel die CPUs verlöten... die wechseln die Sockel wie andere die Unterwäsche 🤣
Andererseits... lieber nicht - wer weiß, zu welchen "Blödheiten" das Verlöten dann führt...
Zumindest bei tsmc ist das so nicht der Fall. SRAM ist schwierig kleiner zu bekommen. Intel könnte da also einen trade of eingehen und die reduzierte Fläche bei den Kernen auf mehr e cores und SRAM aufteilen.
Arrow Lake soll jedem mir bekannten Gerücht zufolge entweder Intel 20 A oder TSMC N3 (vermutlich E) nutzen.
Da MLID in seinem "Intel's Nerfed Future Leak" (war es meine ich, habe ich vor längerer Zeit gesehen) erwähnt hatte, dass momentan die Fertigung die intern gesetzen Ziele erreiche sowie teilweise gar übertreffe, während die Design Teams Probleme hätten. Daher würde ich annehmen, dass 20A auf einem guten Weg ist und im Notebook Bereich erfolgreich eingesetzt werden wird, ähnlich wie Intel 4 jetzt, im Desktop jedoch nicht auf die gleichen Frequenzen geprügelt werden kann, wie N3E/-P/-X und letzteres daher vorgezogen wird
Bei ARL-S fährt Intel zweigleisig. Das 8+16 compute tile wird in TSMC N3 gefertigt, während das kleinere 6+8 tile in 20A gefertigt wird. Bei der N3 Version gehen die meisten von N3B aus.
Zumindest bei tsmc ist das so nicht der Fall. SRAM ist schwierig kleiner zu bekommen. Intel könnte da also einen trade of eingehen und die reduzierte Fläche bei den Kernen auf mehr e cores und SRAM aufteilen.
TSMC hat echt eine komfortable Position. Alle wollen N3, Apple kauft ein ganzes Jahr davon weg, Nvidia will ein grosses Stück und Intel auch. Bin mal gespannt wie es dann 24/25 mit den Verfügbarkeiten wirklich aussieht.
Wobei GAA nochmal die Karten neu mischt. TSMC N2 soll ja erst 2025 oder 2026 kommen und backside power delivery erst mit N2P noch später. Intel ist momentan in einer Übergangsphase. Erst mit 18A wollen sie die Fertigung wieder vereinen, so dass alles über Client, Server, Netzwerk von Intel kommt.
TSMC hat mit N3 auch ihre Probleme gehabt bzw. immer noch, das zieht sich doch lange hin. Nvidia und AMD setzen nächstes Jahr noch auf N4.
Nicht nur, es gab Verzögerungen. Problematisch ist auch, dass N3B nicht Design kompatibel mit N3E ist. Also macht es nur bedingt Sinn, wahrscheinlich setzen AMD und Nvidia gleich auf N3E. Aber der ist nochmal deutlich später dran.
...langsam könnte Intel die CPUs verlöten... die wechseln die Sockel wie andere die Unterwäsche 🤣
Andererseits... lieber nicht - wer weiß, zu welchen "Blödheiten" das Verlöten dann führt...
Zumindest bei tsmc ist das so nicht der Fall. SRAM ist schwierig kleiner zu bekommen. Intel könnte da also einen trade of eingehen und die reduzierte Fläche bei den Kernen auf mehr e cores und SRAM aufteilen.
Hrhr so stimmt es wohl. Intel ist halt aktuell noch bei 10nm, hat noch kein 7nm und/oder EUV am Start. Also da skaliert garantiert noch was beim SRAM und den anderen Dingen, die zu L2 Cahe noch dazu gehören.
Aber tendenziell ist es richtig, es wird da schwieriger, andere Bereiche haben aber riesiges Potenzial, wie Bergamo von AMD zeigt.
Bin gespannt ob deren Pläne aufgehen, oder ob sie wegen irgendwelcher Probleme Arrow Lake doch mit Intel 4 machen müssen (was nichts anderes wäre als Desktop Meteor Lake). Da sie schon mehrmals in der Vergangenheit ihre Pläne geändert haben und mit einem älteren Fertigungsprozess weitergemacht, würde mich das nicht mehr wundern...
Mir schon länger ein Rätsel warum nicht stetig der Cache erweitert wird. Dann könnte man die Taktrate noch leicht herunterschrauben, den Verbrauch (Spannung) dadurch reduzieren und wieder mehr Cache dranpacken.
Spätestens seit Release des Broadwell war klar das dieser Weg Zukunft hat.
